Philips LC4.31E - Page 95

Circuit Diagrams and PWB Layouts
EN 95LC4.31E AA 7.
SSB .3: MUX-Sync Interface
S2B
VSS
S2A
S3B
S1A
S3A
S1B
D3
EN
GND
A0
A1
A2
D1
D2
VDD
NC
S2
IN1
D3
S3
D4
S4
D1
S1
NC
IN3
IN4
GND_HS
D2
IN2
VDD
GND
4X1
G4
4X2
1
2
VDD
VEE VSS
GND_HS
GINA|UINA
GINB|UINB
GSG1
RINB|YINB
RINA|YINA
VCC
GND
BOUT|VOUT
GOUT|UOUT
ROUT|YOUT
NC3
NC2
NC1
VCC
DISABLE
THROUGH
MUXSEL
GSR1
GSB1
BINA|VINA
BINB|VINB
RFC
VFC
RES
FOR CINCH ONLY
MUX-SYNC INTERFACE
*
(CINCH)
G
A
B
C
D
E
F
G
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2E01 C2
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2E08 C7
2E09 C7
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2E11 D7
2E12 D7
2E13 D7
2E14 D7
123 45678 91011
123 45678 91011
A
B
C
D
E
F
(SCART)
*
2V7
(CINCH)
RES
FOR CINCH ONLY
0V4
RES
*
*
2E15 A10
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2E28 C10
2E29 D10
2E30 D10
2E31 E3
2V7
/
/
0V
RES
3E13
RGB TEXT FOR
HER
2E32 E6
2E33 C2
2E34 C2
2E35 D2
2E36 E10
2E37 D10
3E00 A9
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3E02 A9
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3E15 B6
330R
330R
FROM ANALOG-IO
TO SCALER
3E16 B6
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3V2
RES
(SCART)
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3E59 D9
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7E02 A10
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FE01 B2
FE02 B2
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0V
330R
3E15
(SCART)
SYNC INTERFACE
5V4
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FE11 C9
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JMP
JMP
3E16
330R
3E18
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3E17
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3V2
TO SCALER
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*
330R
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IE44 G9
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IE48 B6
IE49 B7
IE50 C2
*
*
FROM SCALER
3V2
FROM HERCULES / SYNC INTERFACE
RES
RES
TO SCALER
OTC
JMP
RESERVED
/
(CINCH)
RES
RES RES RES
RES
3V3
/
0V8
3E34
9
7
14
8
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7
14
10
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F
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MDX
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ADG781BCP
SWITCH
SPST
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19
F
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20
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27
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23
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29 30
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26
F
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3E16
G-Y-ADC
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B-PB-ADC
R-PR-ADC
SOG
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COL_Do(8)_INV
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I_PC_HD_SEL
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SC1_B_CVI_Pb_IN
SC1_G_CVI_Y_IN
RGB|CVI_HDA_SEL
RINA|Pr
II_PC_HD_SEL
G_OTC_SDTV
B_OTC_SDTV
R_OTC_SDTV
R_PR+
AHSYNC
AVSYNC
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SD_HD_SEL
R_PR-
G_Y-
B_PB-
G_Y+
B_PB+
HD_FILTER
Hsync_SDTV
Vsync_SDTV
GINA|YINA
SC1_CVI_DMMI_B_Pb_IN
SC1_CVI_DMMI_G_Y_IN
SC1_CVI_DMMI_R_Pr_IN
SD_HD_SEL
FBL_HSYNC_PIN16_IN
VSYNC_IN
B13 B13
I_16213_013.eps
271008
3139 123 6117.3