SO-DIMM A
M_ A_ D Q3
M_ A_ D Q2
M_ A_ D Q1
M_ A_ D Q3 2
M_ A_ D Q3 1
M_ A_ D Q3 0
M_ A_ D Q2 9
M_ A_ D Q4
M_ A_ D Q3 9
M_ A_ D Q3 7
M_ A_ D Q3 6
M_ A_ D Q3 5
M_ A_ D Q3 4
M_ A_ D Q3 3
M_ A_ D Q4 4
M_ A_ D Q4 3
M_ A_ D Q4 2
M_ A_ D Q4 1
M_ A_ D Q4 0
M_ A_ D Q4 9
M_ A_ D Q3 8
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M_ A_ D Q5
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M_ A_ D Q1 4
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M_ A_ D Q2 1
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M_ A_ D Q1 9
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M_ A_ D Q0
M_ A_ D Q2 2
M_ A_ D Q2 0
M_ A_ D Q2 7
CHANGE TO STANDARD
C108
1u_6.3V_X5R _04
C1 0 6
10u_6.3V_X5R _06
C112
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C1 1 1
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C110
*1u_6.3V_X5R _04
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C102
0.1u_10V_X7R _04
R 72 10K_04
R1 9 *0 _ 0 4
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AS0A621-U 2SN-7F
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98
A1
97
A2
96
A3
95
A4
92
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90
A7
86
A8
89
A9
85
A10/AP
107
A11
84
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83
A13
119
A14
80
A15
78
DQ 0
5
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7
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15
DQ 3
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DQ 4
4
DQ 5
6
DQ 6
16
DQ 7
18
DQ 8
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DQ 9
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DQ 10
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DQ 11
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DQ 12
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DQ 13
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DQ 14
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DQ 15
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DQ 17
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DQ 19
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DQ 27
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DQ 29
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DQ 63
194
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109
BA1
108
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110
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S1#
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CK1
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CK1#
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201
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187
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152
DQS6#
169
DQS7#
186
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116
ODT1
120
BA2
79
C101
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R63 1K_1%_04
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19 9
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77
NC2
12 2
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12 5
VR EF_D Q
1
VS S1
2
VS S2
3
VS S3
8
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9
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44
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128
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196
G2
GND2
G1
GND1
VTT2
204
VTT1
203
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12 6
RESET#
30
EV ENT#
19 8
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12 4
3.3VS
3.3VS
VTT_MEM
1.5V
1.5V
M_A_B S15
M_CLK_DDR15
DDR3_DRAMRST#4,11
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M_A_RAS #5
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M_CS#05
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M _ A_DQ S# [7:0]5
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SA1_DIM 1 1 1
SA1_DIM 0
C LOSE TO SO-DIMM_0
SA0_DIM 1 1 1
SA0_DIM 1
SA1_DIM 1
SA0_DIM 0
RN3
10K_8P4R_04
1
2
3
4 5
6
7
8
2010/01/08
3.3VS
MVREF_DIM0
2.2U? ? :6-07-22511-2A0
20m i l s
signal/space/signal:
Layout Note:
8 / 4 / 8
20mils
+
C3 6 0
*220u_2.5V_B_A
MVREF_D IM0
??CPU SUPPORT
+
C323
*560u_2.5V_6.6*6.6*5.9
C76
*1u_6.3V_X5R _04
C4 9
10u_6.3V_X5R _06
C69
10u_6.3V_X5R_06
C82
*1u_6.3V_X5R _04
C71
1u_6.3V_X5R _04
C84
* 10u_6.3V_ X5R _06
C62
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C75
* 1u_6.3V_X5R _04
1.5V
CLK_SDATA2,11
CLK_SC LK2,11
CU? ?
SA0_D IM 0
SA1_D IM 0
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M_ A_ DM 0
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M_ A_ DM 1
M_ A_ DM 3
M_ A_ DM 4
2010/01/08
M_A_A6
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M_A_A7
M_A_A8
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M_A_A0
M_A_A1
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C329
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M_A_DQ S#6
M_A_DQ S#7
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