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DDR_DATA_18
L1
DDR_DATA_17
L2
DDR_DATA_16
P6
DDR_DM_3
N3
DDR_DQS_3P
P3
DDR_DQS_3N
H2
DDR_DM_2
M5
DDR_DQS_2P
M6
DDR_DQS_2N
G1
DDR_CKE_0
AA1
DDR_CLK_0P
AA2
DDR_CLK_0N
L6
DDR_DATA_15
K1
DDR_DATA_14
J4
DDR_DATA_13
C1
DDR_DATA_12
D1
DDR_DATA_11
J3
DDR_DATA_10
E1
DDR_DATA_9
F1
DDR_DATA_8
H6
DDR_DATA_7
J6
DDR_DATA_6
D3
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C3
DDR_DATA_4
F4
DDR_DATA_3
E3
DDR_DATA_2
E4
DDR_DATA_1
D4
DDR_DATA_0
K2
DDR_DM_1
K4
DDR_DQS_1P
K5
DDR_DQS_1N
B2
DDR_DM_0
G5
DDR_DQS_0P
G6
DDR_DQS_0N
V7
DDR_CKE_1
AD1
DDR_CLK_1P
AD2
DDR_CLK_1N
P5
VREF1_BANK_6
L5
VREF1_BANK_7
FS1_DDR_RESETn
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FS1_DDR_DM1
FS1_DDR_DM0
FS1_DDR_CKE1
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FS1_DDR_D[31]
FS1_DDR_D[30]
FS1_DDR_D[29]
FS1_DDR_D[28]
FS1_DDR_D[27]
FS1_DDR_D[26]
FS1_DDR_D[25]
FS1_DDR_D[24]
FS1_DDR_D[23]
FS1_DDR_D[22]
FS1_DDR_D[21]
FS1_DDR_D[20]
FS1_DDR_D[19]
FS1_DDR_D[18]
FS1_DDR_D[17]
FS1_DDR_D[16]
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FS1_DDR_D[14]
FS1_DDR_D[13]
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FS1_DDR_D[11]
FS1_DDR_D[10]
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FS1_DDR_D[1]
FS1_DDR_D[0]
FS1_DDR_D[31]
FS1_DDR_D[30]
FS1_DDR_D[29]
FS1_DDR_D[28]
FS1_DDR_D[27]
FS1_DDR_D[26]
FS1_DDR_D[25]
FS1_DDR_D[24]
FS1_DDR_D[23]
FS1_DDR_D[22]
FS1_DDR_D[21]
FS1_DDR_D[20]
FS1_DDR_D[19]
FS1_DDR_D[18]
FS1_DDR_D[17]
FS1_DDR_D[16]
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FS1_DDR_D[14]
FS1_DDR_D[13]
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FS1_DDR_D[1]
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FS1_DDR_A[5]
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FS1_DDR_A[1]
FS1_DDR_A[0]
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FS1_DDR_WEn
FS1_DDR_CASn
FS1_DDR_RASn
FS1_DDR_ODT
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FS1_DDR_A[12]
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FS1_DDR_A[10]
FS1_DDR_A[9]
FS1_DDR_A[8]
FS1_DDR_A[7]
FS1_DDR_A[6]
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FS1_DDR_A[4]
FS1_DDR_A[3]
FS1_DDR_A[2]
FS1_DDR_A[1]
FS1_DDR_A[0]
FS1_DDR_CSn
FS1_DDR_WEn
FS1_DDR_CASn
FS1_DDR_RASn
FS1_DDR_ODT
FS1_DDR_RESETn
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FS2_DDR_DM2
FS2_DDR_CLK0_N
FS2_DDR_CLK0_P
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FS2_DDR_DM0
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FS2_DDR_CLK1_P
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FS2_DDR_D[30]
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FS2_DDR_D[24]
FS2_DDR_D[23]
FS2_DDR_D[22]
FS2_DDR_D[21]
FS2_DDR_D[20]
FS2_DDR_D[19]
FS2_DDR_D[18]
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FS2_DDR_D[11]
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FS2_DDR_D[9]
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FS2_DDR_D[3]
FS2_DDR_D[2]
FS2_DDR_D[1]
FS2_DDR_D[0]
FS2_DDR_RESETn
FS2_DDR_D[31]
FS2_DDR_D[30]
FS2_DDR_D[29]
FS2_DDR_D[28]
FS2_DDR_D[27]
FS2_DDR_D[26]
FS2_DDR_D[25]
FS2_DDR_D[24]
FS2_DDR_D[23]
FS2_DDR_D[22]
FS2_DDR_D[21]
FS2_DDR_D[20]
FS2_DDR_D[19]
FS2_DDR_D[18]
FS2_DDR_D[17]
FS2_DDR_D[16]
FS2_DDR_D[0]
FS2_DDR_D[1]
FS2_DDR_D[2]
FS2_DDR_D[3]
FS2_DDR_D[4]
FS2_DDR_D[5]
FS2_DDR_D[6]
FS2_DDR_D[7]
FS2_DDR_D[8]
FS2_DDR_D[9]
FS2_DDR_D[10]
FS2_DDR_D[11]
FS2_DDR_D[12]
FS2_DDR_D[13]
FS2_DDR_D[14]
FS2_DDR_D[15]
FS2_DDR_DM2
FS2_DDR_DM3
FS2_DDR_DM0
FS2_DDR_DM1
FS2_DDR_RESETn
FS2_DDR_ODT
FS2_DDR_RASn
FS2_DDR_CASn
FS2_DDR_WEn
FS2_DDR_CSn
FS2_DDR_A[0]
FS2_DDR_A[1]
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FS2_DDR_A[6]
FS2_DDR_A[7]
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FS2_DDR_A[11]
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FS1_DDR_A[10]
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FS1_DDR_A[3]
FS1_DDR_A[2]
FS1_DDR_A[1]
FS1_DDR_A[0]
FS1_DDR_BA2
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FS1_DDR_BA0
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FS1_DDR_ODT
FS1_DDR_CASn
FS1_DDR_RASn
FS1_DDR_WEn
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FS1_CLK75N
FS2_DDR_A[12]
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FS1_DDR_CLK0_N
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FS1_DDR_A[12]
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FS1_DDR_A[1]
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FS2_DDR_A[1]
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C1809
0.1uF
C1807
MIX-54 (16/42)
BOARD NO. 1-884-046-13
MCS-8M_MIX-54_005_16
MCS-8M
4-31