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Section 17. 10-bit A/D Converter
10-bit A/D
Converter
17
Figure 17-1: 10-Bit High-Speed A/D Block Diagram
S/H
+
-
10-bit Result Conversion Logic
VREF+
AV
SS
AVDD
ADC
Data Format
16-word, 10-bit
Dual Port
RAM
Bus Interface
AN12
0000
0101
0111
1001
1101
1110
1111
1100
0001
0010
0011
0100
0110
1000
1010
1011
AN13
AN14
AN15
AN8
AN9
AN10
AN11
AN2
AN4
AN7
AN0
AN3
AN1
AN5
CH1
CH2
CH3
CH0
AN5
AN2
AN11
AN8
VREF-
AN4
AN1
AN10
AN7
VREF-
AN3
AN0
AN9
AN6
VREF-
AN1
VREF-
VREF-
Sample/Sequence
Control
Sample
CH1,CH2,
CH3,CH0
Input MUX
Control
Input
Switches
S/H
+
-
S/H
+
-
S/H
+
-
AN6
Note: VREF+, VREF- inputs may be shared with other analog inputs. See device data sheet for details.