Contents RM0440
16/2126 RM0440 Rev 4
19.5.1 NOR/PSRAM address mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 518
19.5.2 NAND Flash memory address mapping . . . . . . . . . . . . . . . . . . . . . . . 519
19.6 NOR Flash/PSRAM controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 520
19.6.1 External memory interface signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . 521
19.6.2 Supported memories and transactions . . . . . . . . . . . . . . . . . . . . . . . . 523
19.6.3 General timing rules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 524
19.6.4 NOR Flash/PSRAM controller asynchronous transactions . . . . . . . . . 525
19.6.5 Synchronous transactions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 542
19.6.6 NOR/PSRAM controller registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . 549
19.7 NAND Flash controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 557
19.7.1 External memory interface signals . . . . . . . . . . . . . . . . . . . . . . . . . . . . 558
19.7.2 NAND Flash supported memories and transactions . . . . . . . . . . . . . . 560
19.7.3 Timing diagrams for NAND Flash memory . . . . . . . . . . . . . . . . . . . . . 560
19.7.4 NAND Flash operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 561
19.7.5 NAND Flash prewait functionality . . . . . . . . . . . . . . . . . . . . . . . . . . . . 562
19.7.6 Computation of the error correction code (ECC)
in NAND Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 563
19.7.7 NAND Flash controller registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 564
19.7.8 FMC register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 570
20 Quad-SPI interface (QUADSPI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 572
20.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 572
20.2 QUADSPI main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 572
20.3 QUADSPI functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 572
20.3.1 QUADSPI block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 572
20.3.2 QUADSPI pins . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 573
20.3.3 QUADSPI command sequence . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 574
20.3.4 QUADSPI signal interface protocol modes . . . . . . . . . . . . . . . . . . . . . 576
20.3.5 QUADSPI indirect mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 578
20.3.6 QUADSPI status flag polling mode . . . . . . . . . . . . . . . . . . . . . . . . . . . 579
20.3.7 QUADSPI memory-mapped mode . . . . . . . . . . . . . . . . . . . . . . . . . . . 580
20.3.8 QUADSPI Flash memory configuration . . . . . . . . . . . . . . . . . . . . . . . . 581
20.3.9 QUADSPI delayed data sampling . . . . . . . . . . . . . . . . . . . . . . . . . . . . 581
20.3.10 QUADSPI configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 581
20.3.11 QUADSPI usage . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 582
20.3.12 Sending the instruction only once . . . . . . . . . . . . . . . . . . . . . . . . . . . . 584
20.3.13 QUADSPI error management . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 584
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