Contents RM0090
36/1749 RM0090 Rev 18
36.5 NOR Flash/PSRAM controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1549
36.5.1 External memory interface signals . . . . . . . . . . . . . . . . . . . . . . . . . . . 1550
36.5.2 Supported memories and transactions . . . . . . . . . . . . . . . . . . . . . . . 1552
36.5.3 General timing rules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1553
36.5.4 NOR Flash/PSRAM controller asynchronous transactions . . . . . . . . 1554
36.5.5 Synchronous transactions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1571
36.5.6 NOR/PSRAM control registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1577
36.6 NAND Flash/PC Card controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1584
36.6.1 External memory interface signals . . . . . . . . . . . . . . . . . . . . . . . . . . . 1585
36.6.2 NAND Flash / PC Card supported memories and transactions . . . . . 1587
36.6.3 Timing diagrams for NAND and PC Card . . . . . . . . . . . . . . . . . . . . . 1587
36.6.4 NAND Flash operations . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1588
36.6.5 NAND Flash prewait functionality . . . . . . . . . . . . . . . . . . . . . . . . . . . 1589
36.6.6 Computation of the error correction code (ECC)
in NAND Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1590
36.6.7 PC Card/CompactFlash operations . . . . . . . . . . . . . . . . . . . . . . . . . . 1591
36.6.8 NAND Flash/PC Card control registers . . . . . . . . . . . . . . . . . . . . . . . 1593
36.6.9 FSMC register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1600
37 Flexible memory controller (FMC) . . . . . . . . . . . . . . . . . . . . . . . . . . . 1602
37.1 FMC main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1602
37.2 Block diagram . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1603
37.3 AHB interface . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1604
37.3.1 Supported memories and transactions . . . . . . . . . . . . . . . . . . . . . . . 1605
37.4 External device address mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1606
37.4.1 NOR/PSRAM address mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1607
37.4.2 NAND Flash memory/PC Card address mapping . . . . . . . . . . . . . . . 1608
37.4.3 SDRAM address mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1609
37.5 NOR Flash/PSRAM controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1612
37.5.1 External memory interface signals . . . . . . . . . . . . . . . . . . . . . . . . . . . 1613
37.5.2 Supported memories and transactions . . . . . . . . . . . . . . . . . . . . . . . 1615
37.5.3 General timing rules . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1617
37.5.4 NOR Flash/PSRAM controller asynchronous transactions . . . . . . . . 1617
37.5.5 Synchronous transactions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1634
37.5.6 NOR/PSRAM controller registers . . . . . . . . . . . . . . . . . . . . . . . . . . . 1640
37.6 NAND Flash/PC Card controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1647
37.6.1 External memory interface signals . . . . . . . . . . . . . . . . . . . . . . . . . . . 1648
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