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Infineon Technologies TC1796 User Manual

Infineon Technologies TC1796
2150 pages
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User’s Manual L-21 V2.0, 2007-07
TC1796
System and Peripheral Units (Vol. 1 and 2)
Table of Contents
20.1.2.7 Receive FIFO Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-14 [2]
20.1.2.8 FIFO Transparent Mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-16 [2]
20.1.2.9 Baud Rate Generation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-18 [2]
20.1.2.10 Slave Select Input Operation . . . . . . . . . . . . . . . . . . . . . . . . . . 20-20 [2]
20.1.2.11 Slave Select Output Generation Unit . . . . . . . . . . . . . . . . . . . . 20-21 [2]
20.1.2.12 Error Detection Mechanisms . . . . . . . . . . . . . . . . . . . . . . . . . . 20-24 [2]
20.2 SSC Kernel Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-27 [2]
20.2.1 Identification Register . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-29 [2]
20.2.2 Control Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-30 [2]
20.2.3 Data Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-45 [2]
20.3 SSC0/SSC1 Module Implementation . . . . . . . . . . . . . . . . . . . . . . . 20-46 [2]
20.3.1 Interfaces of the SSC Modules . . . . . . . . . . . . . . . . . . . . . . . . . . 20-46 [2]
20.3.2 SSC0/SSC1 Module Related External Registers . . . . . . . . . . . . 20-47 [2]
20.3.2.1 Clock Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-48 [2]
20.3.2.2 Port Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-52 [2]
20.3.2.3 Interrupt Control Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-59 [2]
20.3.3 DMA Requests . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20-60 [2]
21 Micro Second Channel (MSC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-1 [2]
21.1 MSC Kernel Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-3 [2]
21.1.1 Overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-3 [2]
21.1.2 Downstream Channel . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-5 [2]
21.1.2.1 Frame Formats and Definitions . . . . . . . . . . . . . . . . . . . . . . . . . 21-6 [2]
21.1.2.2 Shift Register Operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-12 [2]
21.1.2.3 Transmission Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-14 [2]
21.1.2.4 Downstream Counter and Enable Signals . . . . . . . . . . . . . . . . 21-19 [2]
21.1.2.5 Baud Rate . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-20 [2]
21.1.2.6 Abort of Frames . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-20 [2]
21.1.3 Upstream Channel . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-21 [2]
21.1.3.1 Data Frames . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-22 [2]
21.1.3.2 Parity Checking . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-22 [2]
21.1.3.3 Data Reception . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-23 [2]
21.1.3.4 Baud Rate . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-25 [2]
21.1.3.5 Spike Filter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-26 [2]
21.1.4 I/O Control . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-27 [2]
21.1.4.1 Downstream Channel Output Control . . . . . . . . . . . . . . . . . . . 21-27 [2]
21.1.4.2 Upstream Channel . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-30 [2]
21.1.5 MSC Interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-31 [2]
21.1.5.1 Data Frame Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-32 [2]
21.1.5.2 Command Frame Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-32 [2]
21.1.5.3 Time Frame Finished Interrupt . . . . . . . . . . . . . . . . . . . . . . . . 21-33 [2]
21.1.5.4 Receive Data Interrupt . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21-34 [2]
21.1.5.5 Interrupt Request Compressor . . . . . . . . . . . . . . . . . . . . . . . . 21-35 [2]

Table of Contents

Questions and Answers:

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Infineon Technologies TC1796 Specifications

General IconGeneral
BrandInfineon Technologies
ModelTC1796
CategoryController
LanguageEnglish